Počet záznamů: 1
Reducing Power Consumption of an Embedded DSP Platform through the Clock-Gating Technique
- 1.
SYSNO 0346745 Název Reducing Power Consumption of an Embedded DSP Platform through the Clock-Gating Technique Tvůrce(i) Heřmánek, Antonín (UTIA-B) [ZS]
Kuneš, Michal (UTIA-B) [ZOI] RID
Tichý, Milan (UTIA-B) [ZS]Zdroj.dok. Proceedings of the International Conference on Field Programmable Logic and Applications. S. 336-339. - Piscataway : IEEE, 2010 Konference 20th International Conference on Field Programmable Logic and Applications, Milano, 31.08.2010-02.09.2010 Druh dok. Konferenční příspěvek (zahraniční konf.) Grant 7H09005 GA MŠMT - Ministerstvo školství, mládeže a tělovýchovy CEZ AV0Z10750506 - UTIA-B (2005-2011) Jazyk dok. eng Země vyd. US Klíč.slova FPGA * Clock Gating * Digital design * System on Chip * Multicore Embedded System * Power consumption URL http://library.utia.cas.cz/separaty/2010/ZS/kunes-reducing power consumption of an embedded dsp platform through the clock-gating technique.pdf Trvalý link http://hdl.handle.net/11104/0187684
Počet záznamů: 1